ラティスが新しい設計ソフトウエアLattice Radiant 2.0でFPGA設計を高速化

最新版はラティスの新しいCrossLink-NX FPGAに対応

米オレゴン州ヒルズボロ--(BUSINESS WIRE)--（ビジネスワイヤ）-- 低消費電力プログラマブルデバイスのリーダー企業であるラティスセミコンダクターコーポレーション（NASDAQ：LSCC）は本日、当社の定評のあるFPGA向けソフトウエア設計ツールの最新版となるLattice Radiant™ 2.0（ラティス・レイディアント2.0）の提供について発表しました。この刷新された設計ツールは、新しいFPGAファミリーのCrossLink-NX™のようなより高密度なデバイスへのサポートを追加したほか、ラティス製FPGAベースの設計をかつてないほど迅速・簡単に開発できる新機能を提供しています。

システム開発者がハードウエアプラットフォームを評価する場合、実際のハードウエアは選択基準の一部でしかありません。開発者がハードウエアの構成で使用する設計ソフトウエアの使い勝手とサポート機能を評価するのは、これらの特徴や機能がシステム開発の全体的な時間とコストに大きな影響を与えるからです。

ラティスのソフトウエア製品ライン担当シニアマネジャーのRoger Doは、次のように述べています。「Lattice Radiant 2.0設計ソフトウエアは、容易に理解できるユーザー体験を開発者に提供します。このツールは、設計の作成から、IPのインポート、導入、ビットストリーム生成、ビットストリームのFPGAへのダウンロードまで、開発者に設計フローの手引きをします。開発者は、FPGA作業の経験がほとんどないか、まったくなくても、Lattice Radiantの自動化機能を速やかに活用できるはずです。また経験があるFPGA開発者は、Lattice Radiant 2.0により、特定の最適化が必要な場合、FPGA構成をよりきめ細かに管理できます。」

Radiant 2.0でアップグレードした新機能には、下記が含まれます。

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  ユーザーはオンチップデバッギングツールにより、バグ修正をリアルタイムで行えます。開発者はこのデバッギング機能を使って、仮想スイッチやLEDをコードに挿入し、その実行可能性を確認できます。またこのツールにより、ユーザーはハードIPブロックの設定を変更して、異なる稼働モードを試験できます。
  


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  タイミング解析を改善し、より精度の高いトレース、ルートプランニング、クロックタイミングを実現し、設計上の高密度化と熱に関する問題を回避できるようにしました。
  


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  開発者は設計変更指示（ECO）エディターを使い、FPGAデータベース全体を再コンパイルすることなく、完成した設計を増分変更できます。
  


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  同時スイッチング出力（SSO）計算機が各ピンの信号の完全性を分析し、各ピン性能が近接しているほかのピンの悪影響を受けないようにします。
  

詳しい情報については、www.latticesemi.com/LatticeRadiantをご覧ください。

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ラティスセミコンダクター（NASDAQ：LSCC）は低消費電力のプログラマブルデバイスのリーダー企業です。当社は、拡大する通信、コンピューティング、産業、自動車、消費者市場において、エッジからクラウドを含むネットワーク全体で、お客さまの問題を解決しています。当社の技術、長期にわたる協力関係、世界レベルのサポートに対する取り組みにより、お客さまは素早く容易に自社の革新の力を解き放ち、スマートかつセキュアで接続された世界を生み出すことができます。

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